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Les Moyens

Dernière mise à jour : jeudi 24 août 2006, par Christine Hu

L’IPHC dispose des moyens logiciels de conception de circuits intégrés Cadence®
qui permettent une saisie hiérarchisée de schémas graphiques ou une description des circuits dans un langage de description hardware permettant une conception "Bottom Up" et "Top Down". A partir de cette conception, la simulation tant logique qu’analogique permet la validation des concepts et la vérification des performances attendues. La réalisation des circuits intégrés en technologie CMOS et BiCMOS aboutit au dessin physique du circuit ou "layout", envoyé au fondeur.

A leur retour de fabrication les circuits sont soumis à des tests de fonctionnalités et de performances.

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Testeur sous pointes
avec wafer Hal25

Les moyens de tests sont :

  • un banc de tests analogique
  • un testeur numérique
  • un télescope pour les tests en faisceau de particules avec son système d’acquisition de données
  • plusieurs testeurs sous pointes
  • deux salles de conditionnement et de tests en atmosphère contrôlée
  • de nombreux appareils de mesures : oscilloscopes numériques, analyseurs de réseaux et de spectres, générateurs d’impulsions de de signaux, etc...